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编解码
  • 本文分析了读写器和标签之间的通信条件,通过配置无线收发芯片的寄存器可设定芯片的工作频率和传输速率,通过调整芯片外围匹配网络的元件参数达到与芯片的工作频率相匹配,并用软件编程实现所需的编解码方式和数据包格式,得到一种新型适应性强的RFID读写器的设计方案。
  • 根据超高频RFID国际标准协议EPC GEN2中的规定,基于ARM9芯片S3C2440提出一种适用于超高频读写器的PIE编码以及MILLER2解码的实现方式。设计中使用该芯片的PWM输出进行编码,并使用其外部中断进行解码。通过分析示波器捕捉到的MILLER2波形以及串口打印的解码输出,验证了该设计的正确性。
  • 使用分立元件搭建的新型超高频读写器方案设计灵活,相比于一些读写器使用集成芯片,这种方法可以大大缩减设计成本,且其性能毫不逊色于市面上大多数读写器。读写器系统包括了软件和硬件两部分,在这里重点讲述其硬件电路的设计并同时介绍软件系统的实现。系统的硬件主要包含了基带信号的处理部分和射频前端,在处理器上配套运行的软件系统主要包括了协议处理、编解码、硬件系统的控制以及与上位机的通信。
  • 提出了一种基于ISO/IEC15693 协议的标签芯片编解码系统设计的实现方法,使编解码更加完整准确。采用Verilog HDL建立RTL模型,用ModelSim进行功能仿真,并在Altera DE2-115与射频前端搭建的平台上进行了FPGA验证。最后不仅功能验证正确,而且比协议中要求的识别凹槽宽度范围广,处理更加灵活,同时减小了射频前端模拟解调的压力。对其他编解码系统的实现也有一定的借鉴意义。
  • 本文分析了读写器和标签之间的通信条件,通过配置无线收发芯片的寄存器可设定芯片的工作频率和传输速率,通过调整芯片外围匹配网络的元件参数达到与芯片的工作频率相匹配,并用软件编程实现所需的编解码方式和数据包格式,得到一种新型适应性强的RFID读写器的设计方案。
  • 为了分析UHF RFID读写器系统抗干扰性能,本文提出了基于ISO18000-6 type B 协议下UHF RFID读写器的设计方案,并对其通信过程进行了Simulink仿真,给出了曼彻斯特编解码以及2ASK调制解调的模型。最后,结合实际中经常遇到的高斯白噪声信道分析了系统的信道抗干扰性能,给出了系统的误码率随信噪比变化曲线。仿真表明本方案所设计的UHF RFID读写器系统具有较高的抗干扰性能。
  • 摘要:本文分析了读写器和标签之间的通信条件,通过配置无线收发芯片的寄存器可设定芯片的工作频率和传输速率,通过调整芯片外围匹配网络的元件参数达到与芯片的工作频率相匹配,并用软件编程实现所需的编解码方式和数据包格式,得到一种新型适应性强的RFID读写器的设计方案。
  • 本文介绍了一种读写器的编解码部分由FPGA来完成的设计方案,由FPGA负责前向链路的PIE编码和后向链路的FM0/miller解码,且解码模块可对标签突发传来的数据立即检测并实施解码,实现了较快的解码速率。FPGA选用的是Altera公司的EP1C3T100C6芯片。
  • 本文探讨了使用MSP430F5系列产品实现ETC系统中实时HDLC编解码的方法。MSP430F5xxx是TI公司MSP430家族最新产品序列,采用先进的0.18工艺,1MIPS消耗的电流低到了惊人的160uA。同时,F5xx产品都配备了高效灵活的DMA模块,对16bit数据进行搬移只需要2个时钟周期。本文给出了结合F5xx的DMA,TimerA,CRC16及SPI,实现几乎实时的HDLC FM0软解码办法和利用SPI的便捷的FM0编码方法。本文包括相关的两个实例代码。
  • 在超高频段, ISO/ IEC 18000-6 标准中6B 多用于交通领域, 而6C 主要用于物流、生产管理和供应链管理领域。分析了ISO/ IEC 18000-6 C 标准, 基于此标准设计了一种超高频射频识别读写器。详细阐述了读写器的软硬件设计, 其中硬件设计主要包括射频发送电路、射频接收电路和数字基带处理电路。读写器软件设计中叙述了整体设计结构、基于概率、槽计数器的防冲突算法、发送接收链路的数据编解码设计、16 bit CRC 校验以及读写器对标签操作命令流程。
  • 本文介绍在无源RFID中应用的密勒码编解码技术,并给出了其软硬件实现的方法。